Verilog HDL华为入门教程

Verilog HDL华为入门教程

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华为入门教程|Verilog HDL华为入门教程

FPGA入门/初级
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6章节

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课程目录

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1
Verilog HDL入门教程
8 课时 · 3时15分
1.1 L01、前言
图文试看
5分
1.2 L02、HDL设计方法学简介
图文
10分
1.3 L03、Verilog HDL建模概述
图文
30分
1.4 L04、Verilog HDL基本语法
图文
30分
1.5 L05、结构建模
图文
30分
1.6 L06、数据流建模
图文
30分
1.7 L07、行为建模
图文
30分
1.8 L08、其他
图文
30分
2
Verilog典型电路设计
2 课时 · 2时
2.1 L11、典型电路的设计
图文试看
1时
2.2 L12、常用电路设计
图文
1时
3
VHDL设计风格和实现
4 课时
3.1 L21、同步设计
图文
--
3.2 L22、速度
图文
--
3.3 L23、资源
图文
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3.4 L24、其他
图文
--
4
业务与软件C++语言项目
3 课时
4.1 第一章 类、接口
图文
--
4.2 第二章 重载
图文
--
4.3 第三章 模板
图文
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5
华为FPGA设计流程指南
2 课时
5.1 华为FPGA设计流程指南
图文
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5.2 海思高校合作——QA培训资料
图文
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6
华为FPGA工程师岗笔试题
1 课时 · 1时
6.1 华为FPGA工程师岗笔试题
图文
1时
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