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AI芯片、RISC-V、国产FPGA都在变,硬件人该盯紧什么?

最近一段时间,如果你在 FPGA、芯片、嵌入式或 AI 硬件圈子里,大概会有一种相似的体感:话题变多了,但结论变少了。AI 芯片团队重新重视 FPGA 原型验证…

FPGA 上跑大模型、EDA 搬上云、Chiplet 热起来:这几条线正在悄悄改写硬件人的日常

最近和几位做 FPGA、数字 IC 的朋友聊天,话题从「怎么把模型塞进板子」一路飘到「EDA 到底能不能上云」「Chiplet 的接口标准什么时候能统一」。这些…

FPGA云课堂火了,但真本事还得靠板子练

最近和几位做FPGA的朋友聊天,话题绕不开“云课堂”。高校在推,企业在试,平台在讲,仿佛一夜之间,学FPGA不用再守着实验室那台老服务器了。但热闹归热闹,一个更…

FPGA小批量出货后,那些没人提前告诉你的坑

做 FPGA 的人常有一种错觉:板子点亮、原型跑通、Demo 演示顺利,项目就算成了。但真正做过量产的人知道,从原型验证走到小批量甚至中等批量出货,才是另一场考…

FPGA小批量量产、AI芯片带宽、EDA云化……这波讨论到底在聊什么

最近和几位做硬件、做逻辑、做采购的朋友聊天,发现一个挺有意思的变化:大家不再只问「这颗芯片能不能跑通」,而是开始追问「它能不能稳定供货」「工具链能不能长期维护」…

FPGA原型、AI写RTL、国产替代……这几条线正在悄悄改写硬件人的日常

最近和几位做 FPGA、芯片验证、数据中心硬件的朋友聊天,发现大家关心的点出奇地一致:不是某个爆款芯片又刷了多少 TOPS,而是那些“跑起来才知道疼”的工程细节…

FPGA 推理加速、Chiplet、车规芯片、国产 EDA、RISC-V:最近这几条线,都在指向同一件事

最近和几位做 FPGA、数字 IC 的朋友聊天,话题从“哪个板子好用”慢慢滑到了“算子适配到底有多痛”“国产 EDA 签核敢不敢用”“RISC-V 上高性能到底…

FPGA原型跑通之后,量产这道坎到底卡在哪?

最近翻看行业里的公开讨论,有个感受越来越明显:大家聊技术的时候,已经不太满足于「这个东西能不能做」,而是开始追问「做完之后怎么落地」。从智驾域控里 FPGA 的…

一块U280 FPGA,把GPT-2 Medium跑成了“命令行聊天机器人”

你训练了一个模型,部署到了云端。但你不知道推理的时候,芯片内部到底发生了什么。今天要讲的项目,把这件事打开了一条缝。 你听说过用FPGA加速大模型,但大多数项目…

400块的FPGA板 + 两块开发板,怎么从零跑通ML硬件加速?

你训练了一个模型,部署到了云端。但如果你想让它跑在只有几毫瓦功耗的嵌入式设备上呢?大多数人会告诉你“这需要ASIC,成本太高”。但这个项目证明,用两块总共不到5…

不调IP核,纯手写三大通信协议:这个Zynq-7020项目,把“黑盒”拆给你看

你调过UART的波特率,配置过SPI的时钟极性,也给I2C设过从机地址。但如果面试官问“起始位是怎么被采样的”“ACK/NACK在硬件里怎么实现”,你能讲清楚吗…

Verilog 除法器设计

位宽可配置的流水线式定点除法器 1  除法器原理(定点) 和十进制除法类似,计算 27 除以 5 的过程如下所示: 1 0 1 (5) -------…

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