课后作业初级 | FPGA工程师基础启航（含板卡+证书） · 01 | 语法讲解：Verilog/VHDL简介
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【作业要求】 1、简述FPGA的开发流程？ 1.需求分析与方案设计：明确功能指标，确定整体方案。 2.设计输入：使用Verilog/VHDL编写硬件描述代码（RTL代码），或者画原理图。 3.功能仿真（前仿真）：编写Testbench，验证逻辑功能是否正确，不涉及硬件时序。 4.综合（Synthesis）：工具把RTL代码翻译成FPGA内部的逻辑单元、连线网表。 5.布局布线（实现Implemen…

郝瑞雄
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3342599708 · 2026-11-05

1、1)需求分析，2)模块划分（画模块框图），3)编写代码，4)综合前仿真（功能仿真），5)综合，6)绑定管脚，7)布局布线，8)生成bit流文件，9)上板测试。 4、不用位宽的话就可以写成下面的这种形式： module LED( output led1 , output led2 , output led3 , output led4 ); assign led1 = 1; assign led2 = 1; assign led3 = 1; assign led4 = 1; endmodule

【作业要求】

1、简述FPGA的开发流程？

1.需求分析与方案设计：明确功能指标，确定整体方案。

2.设计输入：使用Verilog/VHDL编写硬件描述代码（RTL代码），或者画原理图。

3.功能仿真（前仿真）：编写Testbench，验证逻辑功能是否正确，不涉及硬件时序。

4.综合（Synthesis）：工具把RTL代码翻译成FPGA内部的逻辑单元、连线网表。

5.布局布线（实现Implementation）：把网表映射到FPGA芯片真实资源，安排器件位置和走线。

6.时序仿真（后仿真）：包含走线延迟，验证时序能不能满足要求。

7.生成比特流文件（Bitstream）：生成可以下载到FPGA的配置文件。

8.板级下载与调试：把文件烧写到开发板，上板测试、调试bug。

2、一个模块包含哪两部分？

端口定义部分，模块逻辑描述部分

3、时间尺度定义为`timescale 1ns/100ps 中的 1ns 代表（c）。

A、时间精度 1ns

B、时间单位 100ps

C、时间单位 1ns

D、时间周期1ns

4、点亮开发板上的4个led灯，请写出详细的代码？

module LED(
output [3:0] LED
);
assign LED=4'b1111;
endmodule

【我的做法】

【结果/时序图/实验现象(可视频)】

修改历程

2 条批注

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  3. 需修改
    1、1)需求分析，2)模块划分（画模块框图），3)编写代码，4)综合前仿真（功能仿真），5)综合，6)绑定管脚，7)布局布线，8)生成bit流文件，9)上板测试。 4、不用位宽的话就可以写成下面的这种形式： module LED( output led1 , output led2 , output led3 , output led4 ); assign led1 = 1; assign led2 = 1; assign led3 = 1; assign led4 = 1; endmodule

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初级 | FPGA工程师基础启航（含板卡+证书）
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01 | 语法讲解：Verilog/VHDL简介

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