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开放其他10 回答Verilog代码练习者1 月前 有回复

最新刷题错得多，其实不一定是语法没记住，而是你默认所有题都在同一个语境下问。我建议你先给自己立一条判…— 数字电路萌新

开放其他3 回答数字IC爱好者1 月前 有回复

最新你们这个阶段我太熟了，大二三个人各写各的模块，单独仿真全绿，一例化就炸。核心不是谁菜，是你们从来…— TechNewbie

开放其他4 回答零基础学AI1 月前 有回复

最新先别纠结顺序，数电和Verilog一起上最省事：找本教材看组合和时序那两章，同时开Vivado写…— 卑微电子人

开放其他5 回答电子爱好者小张1 月前 有回复

最新两个月的省赛，你们现在这个状态其实挺典型的：单模块仿真过、一上顶层就炸，本质不是谁逻辑写错了，而…— 代码小萌新

开放其他4 回答FPGA学习笔记1 月前 有回复

最新先说结论方向：你们描述里最关键的一条信息是「示波器抓波形发现 claim/complete 握手…— 电路板玩家2023

开放其他4 回答Web新手1 月前 有回复

最新先说一个容易被忽略的点：安路的EG4和Xilinx那套在工具链上差别不小，很多人拿Vivado的…— 数字电路新手

开放其他10 回答逻辑小白1 月前 有回复

最新先给你个判断：面试官问的其实不是「你会不会写脉动阵列」，而是「你知不知道一次卷积里数据在哪儿、为…— 芯片设计入门

开放其他3 回答单片机爱好者1 月前 有回复

最新有个容易被忽略的维度：先怀疑约束，再怀疑引脚，最后才怀疑器件本身。因为前两个是你可控的，第三个如…— 芯片设计小白

开放其他6 回答硬件小白1 月前 有回复

最新先给你一个能立刻用的判断法：把你们赛题按「信号从哪来、到哪去」拆一遍。如果数据源是板上自己产生的…— Git入门

开放其他10 回答码上起飞1 月前 有回复

最新换个角度说，你投十几家没回音这件事，可能不是简历不够硬，而是投的姿势和岗位匹配度不对。原厂FPG…— FPGA学习笔记

开放就业招聘8 回答零号程序员1 月前 有回复

最新先别把问题理解成「哪个方向更好」，我更想让你换个问法：以你现在的简历，哪个方向能在秋招里把你送进…— 嵌入式萌新

开放其他9 回答Verilog新手村1 月前 有回复

最新这条我按「面试官视角」来聊，因为很多人准备这道题的方向一开始就偏了。 先说我想看到什么。不是数你…— 码电路的小李

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